Name: Multi Level Clock / Data Input to CML Receiver / Buffer / Translator, 2.5 Gbps, 3.3 V
Brand: Multi Level Clock / Data Input to CML Receiver / Buffer / Translator, 2.5 Gbps, 3.3 V
SKU: NB4N11M

マルチ・レベル・クロック / CML レシーバへのデータ入力 / バッファ / トランスレータ、2.5 Gbps、3.3 V

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CAD Model

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NB4N11M は、CML 出力構造を備えた差動 1 対 2 クロック/データ分散/変換チップであり、高速クロック/データ・アプリケーションを対象としています。このデバイスは、EP11、LVEP11、SG11、または 7L11M デバイスと機能的には同等です。最大 2.5 GHz または 2.5 Gb/s でそれぞれ動作するクロックまたはデータ信号の、2 つの同一の差動出力コピーを作成します。したがって、NB4N11M は SONET、GigE、ファイバ・チャネル、バックプレーン、およびその他のクロック/データ分散アプリケーションに最適です。入力は LVPECL、CML、LVCMOS、LVTTL、または LVDS を受け入れます。CML 出力は 16 mA オープンコレクタであり、VTT 終端電圧への抵抗 (RL) 負荷パスが必要です。オープンコレクタ CML 出力は、電源投入時に VTT で終端する必要があります。1.8 V、2.5 V、または 3.3 V の電源に接続された 50 Ω または 25 Ω の負荷でレシーバをロードすると、差動出力は電流モード・ロジック (CML) 互換レベルを生成します。これにより、カップリング・キャパシタが不要になり、デバイスのインタフェースが簡素化されます。

アプリケーション

Clock distribution in high speed networking and Automated Test Equipment.

特長

Maximum Input Clock Frequency > 2.5 GHz
Maximum Input Data Rate > 2.5 Gb/s
Typically 1 ps of RMS Clock Jitter
Typically 10 ps of Data Dependent Jitter @ 2.5 Gb/s, R_L = 25 Ω
420 ps Typical Propagation Delay
150 ps Typical Rise and Fall Times
Operating Range: V_CC = 3.0 V to 3.6 V with V_EE = 0 V and V_TT = 1.8 V to 3.6 V
Functionally Compatible with Existing 2.5 V / 3.3 V LVEL, LVEP, EP, and GigaComm Devices
These are Pb-Free Devices

材料組成

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CAD Models

Compliance

Package Type

Case Outline

MSL Type

MSL Temp (°C)

Container Type

Container Qty.

Type

Channels

Input / Output Ratio

Input Level

Output Level

V_CC Typ (V)

t_JitterRMS Typ (ps)

t_skew(o-o) Max (ps)

t_pd Typ (ns)

t_R & t_F Max (ps)

f_maxClock Typ (MHz)

f_maxData Typ (Mbps)

Reference Price

NB4N11MDTR2G

Active

TSSOP-8

948R-02

260

REEL

2500

Buffer

1:2

LVTTL

CML

3.3

0.42

300

2500

Price N/A

製品番号:

代理店		Stock	BUY

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Drivers & Fanout Buffers | NB4N11M

マルチ・レベル・クロック / CML レシーバへのデータ入力 / バッファ / トランスレータ、2.5 Gbps、3.3 V

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