Arithmetic Functions | MC10EL34

5.0 V ECL ÷·2、÷·4、÷·8 クロック生成チップ

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MC10/100EL34 は低スキュー 2 分割、4 分割、8 分割クロック生成チップで、低スキュー・クロック生成アプリケーション向けに明示的に設計されています。この内部ディバイダは互いに同期するため、コモン出力端はすべて高精度に整合されます。このデバイスは差動またはシングルエンド ECL で駆動できますし、正電源を使用する場合、PECL 入力信号でも駆動できます。さらに、VBB 出力を使用すると、正弦波源をこのデバイスに AC 結合させることができます (ECLinPS データ・ブック DL140/D のインタフェースのセクションを参照)。シングルエンド入力を使用する場合、VBB 出力を CLK 入力に接続し、0.01 F キャパシタを介してグランドへバイパスする必要があります。VBB 出力は、シングルエンド入力条件で、EL34 の入力のスイッチング・リファレンスとして動作するように設計されています。そのため、このピンが、ソース／シンクできる電流は最大 0.5mA です。コモン・イネーブル (EN) は、内部クロックがすでに LOW 状態の時にのみ内部ディバイダが有効化/無効化されるように同期します。これにより、デバイスが有効化/無効化される時、非同期制御により発生する可能性のあるラント・クロック・パルスが内部クロックで生成されないようにします。内部ラント・パルスが原因で、内部ディバイダ・ステージ間の同期が失われる可能性があります。内部イネーブル・フリップフロップは入力クロックの立下りエッジでクロックされるため、すべての関連する仕様限界はクロック入力の負エッジにリファレンスされます。起動時に、内部フリップフロップはランダム状態に達するため、マスタ・リセット (MR) により、内部ディバイダと、システム内の複数の EL34 の同期が可能です。100 シリーズには温度補償があります。

  • 50ps Output-to-Output Skew
  • Synchronous Enable/Disable
  • Master Reset for Synchronization
  • PECL Mode Operating Range: VCC = 4.2 V to 5.7 V with VEE = 0 V
  • NECL Mode Operating Range: VCC = 0 V with VEE = -4.2 V to -5.7 V
  • Internal Input Pulldown Resistors on CLK(s), ENbar, and MR
  • Pb-Free Packages are Available

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fMax Typ (MHz)

tpd Typ (ns)

tR & tF Max (ps)

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MC10EL34DG

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Pb

A

H

P

SOIC-16

751B-05

1

260

TUBE

48

Y

Divider

ECL

ECL

5

1100

1.08

475

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Device: MC10EL34DG

Equivalent to wafer fab process: MOSAIC

製品技術

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等価デバイス時間

MTBF/MTTF (時間)

FITS

MOSAIC

0

476668904

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Data is based on the following assumptions.

Note: The temperature and confidence level may be adjusted to your requirements.

Disclaimer: A reliability FIT rate calculated using this tool shall not be used for any functional safety purpose. In case a raw FIT rate needs to be estimated for a component which is targeted to be used in a safety critical application (i.e. compliant to ISO 26262 standard) it should be calculated according to generic safety standards (IEC62380, IEC61709, SN29500, FIDES, etc.)

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