Drivers & Fanout Buffers | MC100EP809

クロック・ドライバ、2

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MC100EP809 は、低スキュー 2:1:9 差動バス・クロック・ドライバで、クロック分散を念頭に置いて設計され、2 つのクロック・ソースを 1 つの入力マルチプレクサで受け付けます。このパーツは高精度に整合された低スキュー信号をその行先に駆動するために多くの出力を必要とする低電圧アプリケーション向けに設計されています。2 つのクロック入力は、差動 HSTL が 1 つ、差動 LVPECL が 1 つです。どちらの入力ペアでも LVDS レベルを受け付けられます。LVTTL である CLK_SEL ピンで選択されます。デバイスが有効化/無効化される時、ラント・クロック・パルスが生成されないようにするため、LVTTL である出力イネーブル (OE) は同期して、すでに LOW 状態の時に出力だけが有効化/無効化されるようにします。MC100EP809 は低出力間スキューを保証します。最適な設計、レイアウト、処理により、デバイス内およびロット間でのスキューが最小限に抑えられます。MC100EP809 出力構造はオープン・エミッタ・アーキテクチャを使用して、標準 HSTL 構成ではなく 50 からグランドにして終端されます。確実に厳密なスキュー使用を実現するため、使用されている出力が 1 個でも両側の差動出力を等しく 50 に終端させる必要があります。 出力ペアが使用されていない場合、スキューに影響を与えずに両出力をオープンのままにできます (終端しません)。設計者は EP809 の性能を生かして、低スキュー・クロックをボードのバックプレーンに分配することができます。 HSTL クロック入力は入力ペアの非駆動ピンをバイアスして、シングルエンドで駆動できます。

  • Clock distribution
  • 100 ps Typical Device-to-Device Skew
  • 15 ps Typical Within Device Skew
  • HSTL Compatible Outputs Drive 50Ω to Ground with no Offset Voltage
  • Maximum Frequency > 750 MHz
  • 850 ps Typical Propagation Delay
  • Fully Compatible with Micrel SY89809L
  • PECL and HSTL Mode Operating Range: VCCI = 3 V to 3.6 V with GND = 0 V, VCCO = 1.6 V to 2.0 V
  • Open Input Default State
  • Pb-Free Packages are Available

材料組成

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MSL Type

MSL Temp (°C)

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Input / Output Ratio

Input Level

Output Level

VCC Typ (V)

tJitterRMS Typ (ps)

tskew(o-o) Max (ps)

tpd Typ (ns)

tR & tF Max (ps)

fmaxClock Typ (MHz)

fmaxData Typ (Mbps)

Reference Price

MC100EP809MNG

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CAD Model

Pb

A

H

P

QFN-32

488AM

1

260

TUBE

74

Y

Buffer

1

2:1:9

LVDS

HSTL

3.3

1.4

50

0.85

600

750

-

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