2.5 V、3.3 V 差動 1

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NB3L208K は差動 1:8 クロック・ファンアウト・バッファで、高速電流ステアリング・ロジック (HCSL) 出力を備えています。入力は差動 LVPECL、LVDS、および HCSL 信号を直接受け付けます。シングルエンドの LVPECL、HCSL、LVCMOS、または LVTTL レベルは図 4 および 6 のように適切な外部 Vth リファレンスで受け付けられます。入力信号は HCSL に変換され、最大 350 MHz まで動作するコピーを 8 つ提供します。NB3L208K は超低フェーズ・ノイズ、伝播遅延変動、および低出力間スキュー向けに最適化され、DB800H に準拠しています。したがって、システム設計者は NB3L208K の性能を生かして低スキュークロックをバックプレーンまたはマザーボードに分配することができるため、PCI Express、FBDIMM、ネットワーキング、モバイル・コンピューティング、ギガビット・イーサネットなどのようなクロックおよびデータ分配のアプリケーションに最適になります。出力駆動電流は図 11 のように 475 抵抗を IREF (ピン 27) から GND に接続して設定されます。出力は図 12 のように終端されると LVDS レシーバにインタフェースすることができます。

  • Mobile Computing
  • Networking
  • Gigabit Ethernet
  • FBDIMM
  • PCI Express Gen 3 and Gen 4
  • Maximum Input Clock Frequency > 350 MHz
  • 2.5 V ±5% / 3.3 V ±10% Supply Voltage Operation
  • 8 HCSL Outputs
  • DB800H Compliant
  • Individual OE Control Pin for Each Bank of 2 Outputs
  • 100 ps Max Output−to−Output Skew Performance
  • 1 ns Typical Propagation Delay
  • 450 ps Typical Rise and Fall Times
  • 80 fs Maximum Additive Phase Jitter RMS
  • PCIe Gen 3 and Gen 4 Compliant

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Compliance

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MSL Type

MSL Temp (°C)

Container Type

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Type

Channels

Input / Output Ratio

Input Level

Output Level

VCC Typ (V)

tJitterRMS Typ (ps)

tskew(o-o) Max (ps)

tpd Typ (ns)

tR & tF Max (ps)

fmaxClock Typ (MHz)

fmaxData Typ (Mbps)

Pricing ($/Unit)

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NB3L208KMNTXG

Active

Pb

A

H

P

QFN-32

1

260

REEL

1000

Y

Buffer

1

1:8

LVPECL

HCSL

3.3

0.046

20

1

700

350

-

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