クロック / データ・ファンアウト・バッファ、1

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Overview

NB6L611 は差動 1:2 クロックまたはデータ・ファンアウト・バッファです。VTD ピン経由でアクセス可能な差動入力は 50 Ω 終端抵抗を内蔵し、LVPECL、CML、LVDS、LVCMOS、LVTTL ロジックレベルを受け付けられます。内部生成電圧源である VREFAC ピンは、このデバイスでのみ使用できます。VREFAC は、シングルエンド PECL または NECL 入力のリファレンス電圧として使用されます。シングルエンド入力状態では、使用されていない相補型差動入力は、スイッチング・リファレンス電圧として VREFAC に接続されます。また、VREFAC がキャパシタ結合された入力を再バイアスすることもできます。使用する場合は、0.01uF キャパシタ経由で VREFAC の結合を解除し、電流のソースまたはシンクを 0.5mA に制限します。使用しない場合は、VREFAC 出力は必ずオープンのままにします。小型の 3 mm x 3 mm 16 ピン QFN パッケージで提供されます。NB6L611 は高性能クロックおよびデータ管理製品 ECLinPS MAX ファミリのメンバーです。

  • Clock / Data Distribution

  • Maximum Input Clock Frequency > 3.0 GHz
  • VREFAC Reference Output
  • Internal Input Termination Resistors, 50-ohm

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製品

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CAD Models

Compliance

Package Type

Case Outline

MSL Type

MSL Temp (°C)

Container Type

Container Qty.

ON Target

Type

Channels

Input / Output Ratio

Input Level

Output Level

VCC Typ (V)

tJitterRMS Typ (ps)

tskew(o-o) Max (ps)

tpd Typ (ns)

tR & tF Max (ps)

fmaxClock Typ (MHz)

fmaxData Typ (Mbps)

Reference Price

NB6L611MNG

Loading...

Active

CAD Model

Pb

A

H

P

QFN-16

1

260

TUBE

123

Y

Buffer

1

1:2

CML

CMOS

ECL

LVDS

TTL

ECL

3.3

0.2

15

0.28

170

4000

-

Price N/A

More Details

NB6L611MNR2G

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CAD Model

Pb

A

H

P

QFN-16

1

260

REEL

3000

Y

Buffer

1

1:2

CML

CMOS

ECL

LVDS

TTL

ECL

3.3

0.2

15

0.28

170

4000

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