Flip-Flops, Latches & Registers | NB4L52

2.5 ～ 5.5 V ECL D フリップフロップ、差動リセットおよび入力終端付き

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NB4L52 は差動データおよびクロック D フリップフロップで、差動非同期リセット付きです。差動入力は 50 Ω 終端抵抗を内蔵し、LVPECL、LVCMOS、LVTTL、CML、LVDS ロジックレベルを受け付けられます。クロックが Low から High に移行すると、データは差動 LVPECL 出力に転送されます。差動クロック入力により、NB4L52 は負エッジ・トリガされるデバイスとしても使用できます。小型の 3 mm x 3 mm 16 ピン QFN パッケージで提供されます。

  • High Performance Logic for ATE and Networking

  • Maximum Input Clock Frequency > 4 GHz Typical
  • 330 ps Typical Propagation Delay
  • 145 ps Typical Rise and Fall Times
  • Differential LVPECL Outputs, 750 mV PeaktoPeak, Typical
  • Operating Range: VCC = 2.375 V to 5.5 V with VEE = 0 V

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Case Outline

MSL Type

MSL Temp (°C)

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Type

Bits

Input Level

Output Level

VCC Typ (V)

tJitter Typ (ps)

tpd Typ (ns)

tsu Min (ns)

th Min (ns)

trec Typ (ns)

tR & tF Max (ps)

fToggle Typ (MHz)

Reference Price

NB4L52MNG

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CAD Model

Pb

A

H

P

QFN-16

485G-01

1

260

TUBE

123

Y

D-Type

1

CML

CMOS

ECL

LVDS

ECL

5

1

0.4

0.1

0.05

0.4

190

4000

Price N/A

More Details

NB4L52MNR2G

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CAD Model

Pb

A

H

P

QFN-16

485G-01

1

260

REEL

3000

Y

D-Type

1

CML

CMOS

ECL

LVDS

ECL

5

1

0.4

0.1

0.05

0.4

190

4000

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信頼性データ

Die Related Summary Data

Device: NB4L52MNG

Equivalent to wafer fab process: MOSAIC

製品技術

製品技術

等価デバイス時間

MTBF/MTTF (時間)

FITS

MOSAIC

0

476668904

More Details

Re-calculate Data

Data is based on the following assumptions.

Note: The temperature and confidence level may be adjusted to your requirements.

Disclaimer: A reliability FIT rate calculated using this tool shall not be used for any functional safety purpose. In case a raw FIT rate needs to be estimated for a component which is targeted to be used in a safety critical application (i.e. compliant to ISO 26262 standard) it should be calculated according to generic safety standards (IEC62380, IEC61709, SN29500, FIDES, etc.)

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