Latches & Registers | MC14042B

クワッド透明ラッチ

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MC14042B クワッド透明ラッチは、MOS P/N チャネル・エンハンスメントモード・デバイスによって構築されており、シングル・モノリシック構造になっています。各ラッチには個別のデータ入力がありますが、4 つのラッチすべてが同じクロックを共有します。ラッチを介してデータをストローブするために使用されるクロック極性 (HIGH または LOW) は、極性入力を使用して反転できます。データ入力にある情報は、極性入力によって決定されるクロック・レベル中に出力 Q および Q に転送されます。極性入力がロジック「0」状態の場合、データは低クロック・レベル中に転送され、極性入力がロジック「1」状態の場合、転送は高クロック・レベル中に行われます。

  • Buffered Data Inputs
  • Common Clock
  • Clock Polarity Control
  • Q and Qbar Outputs
  • Double Diode Input Protection
  • Supply Voltage Range = 3.0 Vdc to 1 8 Vdc
  • Capable of Driving Two Low-power TTL Loads or One Low-power Schottky TTL Load Over the Rated Temperature Range
  • Pb-Free Packages are Available*

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MC14042BDG

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Obsolete

CAD Model

Pb

A

H

P

SOIC-16

751B-05

1

260

TUBE

48

N

Latch

4

3

18

180

2.25

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MC14042BDR2G

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CAD Model

Pb

A

H

P

SOIC-16

751B-05

1

260

REEL

2500

N

Latch

4

3

18

180

2.25

$0.2145

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NLV14042BDG

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Pb

A

H

P

SOIC-16

751B-05

1

260

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48

N

Latch

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3

18

180

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Pb

A

H

P

SOIC-16

751B-05

1

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REEL

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N

Latch

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3

18

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信頼性データ

Die Related Summary Data

Device: MC14042BDG

Equivalent to wafer fab process: CMOS STD

製品技術

製品技術

等価デバイス時間

MTBF/MTTF (時間)

FITS

CMOS STD

3

3597164517

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Re-calculate Data

Data is based on the following assumptions.

Note: The temperature and confidence level may be adjusted to your requirements.

Disclaimer: A reliability FIT rate calculated using this tool shall not be used for any functional safety purpose. In case a raw FIT rate needs to be estimated for a component which is targeted to be used in a safety critical application (i.e. compliant to ISO 26262 standard) it should be calculated according to generic safety standards (IEC62380, IEC61709, SN29500, FIDES, etc.)

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