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クロック & データ分配 [Product View]

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差動&シングルエンドCMOS、ECL、PECL、CML、LVDS、HSTL、HCSL

オン・セミコンダクタは、高周波シングルエンドCMOSデバイス、および優れたジッタ/スキュー性能を持つエミッタ結合ロジック(ECL)デザイン手法を駆使したデバイスを提供しています。PureEdge™GigaComm™ECLinPS MAX™ECLinPS Plus™ECLinPS Lite™ECLinPS™MECL-10KH™/MECL-100KH™、および MECL™ ファミリのデバイスがあります。

ツール
 

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   Interactive Block Diagrams
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  Ask An Expert
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演算ファンクション  (41)
   
 

カウンタ - 分周器 - プリスケーラ

カウンタ、分周器、プリスケーラなどの微分 (ECL) 演算ファンクション。
技術資料 & デザイン・リソース
アプリケーション ノート (24) パッケージ図 (14)
シミュレーション・モデル (61) 評価ボード文書 (1)
データシート (41) 評価/開発ツール (7)
 
 
フリップフロップ、ラッチ、レジスタ  (51)
   
 

D FF - JK FF - ラッチ - レジスタ - シフト・レジスタ

差動 (ECL) Dフリップフロップ、JKフリップフロップ、ラッチ、レジスタ、シフトレジスタ。
技術資料 & デザイン・リソース
アプリケーション ノート (25) パッケージ図 (11)
シミュレーション・モデル (63) 評価/開発ツール (1)
データシート (39)  
 
 
ロジック・ゲート  (34)
   
 
AND、 NAND、 OR、 NOR、 XOR、 XNOR、INV ゲートを含む差動 (ECL) ロジックゲート。
技術資料 & デザイン・リソース
アプリケーション ノート (25) データシート (35)
シミュレーション・モデル (54) パッケージ図 (8)
 
 
マルチプレクサ&クロスポイント・スイッチ  (55)
   
 
2:1、4:1、8:1、16:1 差動 (ECL) マルチプレクサ (MUX)、2:10 差動 (ECL) クロスポイント・スイッチ。
技術資料 & デザイン・リソース
アプリケーション ノート (28) パッケージ図 (14)
シミュレーション・モデル (66) 評価/開発ツール (5)
データシート (56)  
 
 
シリアル/パラレル・コンバータ  (5)
   
 
差動 (ECL) パラレル - シリアル、シリアルl - パラレル・コンバータ。
技術資料 & デザイン・リソース
アプリケーション ノート (18) データシート (4)
シミュレーション・モデル (7) パッケージ図 (2)
 
 
スキュー・マネージメント  (9)
   
 
クロック・スキュー・マネジメント用プログラマブル・ディレイライン。
技術資料 & デザイン・リソース
アプリケーション ノート (19) パッケージ図 (3)
シミュレーション・モデル (10) 評価/開発ツール (2)
データシート (8)  
 
 
トランスレータ  (50)
   
 

ロジックレベル・トランスレータ

差動 (ECL)ロジックレベル・トランスレータ that interface with ECL, PECL, CML, LVDS, HSTL, HCSL, TTL, and CMOS devices。

技術資料 & デザイン・リソース
アプリケーション ノート (25) パッケージ図 (14)
シミュレーション・モデル (57) 評価/開発ツール (1)
データシート (44)  
 
 
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NB3N4666C  Quad LVCMOS Differential Line Receiver Translator

  • Data rates up to 400 Mbps at 200 MHz
  • High impedance outputs when disabled to minimize power loss
  • Supports open, short, and terminated input fail-safes